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海南機(jī)械PCI-E測試

來源: 發(fā)布時(shí)間:2023-03-17

關(guān)于各測試項(xiàng)目的具體描述如下:·項(xiàng)目2.1Add-inCardTransmitterSignalQuality:驗(yàn)證插卡發(fā)送信號質(zhì)量,針對2.5Gbps、5Gbps、8Gbps、16Gbps速率?!ろ?xiàng)目2.2Add-inCardTransmitterPulseWidthJitterTestat16GT/s:驗(yàn)證插卡發(fā)送信號中的脈沖寬度抖動(dòng),針對16Gbps速率?!ろ?xiàng)目2.3Add-inCardTransmitterPresetTest:驗(yàn)證插卡發(fā)送信號的Preset值是否正確,針對8Gbps和16Gbps速率。·項(xiàng)目2.4AddinCardTransmitterInitialTXEQTest:驗(yàn)證插卡能根據(jù)鏈路命令設(shè)置成正確的初始Prest值,針對8Gbps和16Gbps速率?!ろ?xiàng)目2.5Add-inCardTransmitterLinkEqualizationResponseTest:驗(yàn)證插卡對于鏈路協(xié)商的響應(yīng)時(shí)間,針對8Gbps和16Gbps速率。PCIE 系統(tǒng)架構(gòu)及物理層一致性測試;海南機(jī)械PCI-E測試

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為了克服大的通道損耗,PCle5.0接收端的均衡能力也會(huì)更強(qiáng)一些。比如接收端的 CTLE均衡器采用了2階的CTLE均衡,其損耗/增益曲線有4個(gè)極點(diǎn)和2個(gè)零點(diǎn),其直流增益可以在-5~ - 15dB之間以1dB的分辨率進(jìn)行調(diào)整,以精確補(bǔ)償通道損耗的  影響。同時(shí),為了更好地補(bǔ)償信號反射、串?dāng)_的影響,其接收端的DFE均衡器也使用了更復(fù) 雜的3-Tap均衡器。對于發(fā)射端來說,PCle5.0相對于PCIe4.0和PCIe3.0來說變化不大, 仍然是3階的FIR預(yù)加重以及11種預(yù)設(shè)好的Preset組合。自動(dòng)化PCI-E測試廠家現(xiàn)貨PCI-e 3.0簡介及信號和協(xié)議測試方法;

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這么多的組合是不可能完全通過人工設(shè)置和調(diào)整  的,必須有一定的機(jī)制能夠根據(jù)實(shí)際鏈路的損耗、串?dāng)_、反射差異以及溫度和環(huán)境變化進(jìn)行  自動(dòng)的參數(shù)設(shè)置和調(diào)整,這就是鏈路均衡的動(dòng)態(tài)協(xié)商。動(dòng)態(tài)的鏈路協(xié)商在PCIe3.0規(guī)范中  就有定義,但早期的芯片并沒有普遍采用;在PCIe4.0規(guī)范中,這個(gè)要求是強(qiáng)制的,而且很  多測試項(xiàng)目直接與鏈路協(xié)商功能相關(guān),如果支持不好則無法通過一致性測試。圖4.7是  PCIe的鏈路狀態(tài)機(jī),從設(shè)備上電開始,需要經(jīng)過一系列過程才能進(jìn)入L0的正常工作狀態(tài)。 其中在Configuration階段會(huì)進(jìn)行簡單的速率和位寬協(xié)商,而在Recovery階段則會(huì)進(jìn)行更  加復(fù)雜的發(fā)送端預(yù)加重和接收端均衡的調(diào)整和協(xié)商。

PCIe4.0的物理層技術(shù)PCIe標(biāo)準(zhǔn)自從推出以來,1代和2代標(biāo)準(zhǔn)已經(jīng)在PC和Server上使用10多年時(shí)間,正在逐漸退出市場。出于支持更高總線數(shù)據(jù)吞吐率的目的,PCI-SIG組織分別在2010年和2017年制定了PCIe3.0和PCIe4.0規(guī)范,數(shù)據(jù)速率分別達(dá)到8Gbps和16Gbps。目前,PCIe3.0和PCle4.0已經(jīng)在Server及PC上使用,PCIe5.0也在商用過程中。每一代PCIe規(guī)范更新的目的,都是要盡可能在原有PCB板材和接插件的基礎(chǔ)上提供比前代高一倍的有效數(shù)據(jù)傳輸速率,同時(shí)保持和原有速率的兼容。別看這是一個(gè)簡單的目的,但實(shí)現(xiàn)起來并不容易。pcie 有幾種類型,哪個(gè)速度快?

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另外,在PCIe4 .0發(fā)送端的LinkEQ以及接收容限等相關(guān)項(xiàng)目測試中,都還需要用到能 與被測件進(jìn)行動(dòng)態(tài)鏈路協(xié)商的高性能誤碼儀。這些誤碼儀要能夠產(chǎn)生高質(zhì)量的16Gbps信  號、能夠支持外部100MHz參考時(shí)鐘的輸入、能夠產(chǎn)生PCIe測試需要的不同Preset的預(yù)加  重組合,同時(shí)還要能夠?qū)敵龅男盘栠M(jìn)行抖動(dòng)和噪聲的調(diào)制,并對接收回來的信號進(jìn)行均 衡、時(shí)鐘恢復(fù)以及相應(yīng)的誤碼判決,在進(jìn)行測試之前還需要能夠支持完善的鏈路協(xié)商。17是 一 個(gè)典型的發(fā)射機(jī)LinkEQ測試環(huán)境。由于發(fā)送端與鏈路協(xié)商有關(guān)的測試項(xiàng)目  與下面要介紹的接收容限測試的連接和組網(wǎng)方式比較類似,所以細(xì)節(jié)也可以參考下面章節(jié)  內(nèi)容,其相關(guān)的測試軟件通常也和接收容限的測試軟件集成在一起。PCI-E3.0定義了11種發(fā)送端的預(yù)加重設(shè)置,實(shí)際應(yīng)用中應(yīng)該用那個(gè)?自動(dòng)化PCI-E測試廠家現(xiàn)貨

PCIE物理層鏈路一致性測試狀態(tài)設(shè)計(jì);海南機(jī)械PCI-E測試

測試類型8Gbps速率16Gbps速率插卡RX測試眼寬:41.25ps+0/—2ps眼寬:18.75ps+0.5/-0.5ps眼高:46mV+0/-5mV眼高:15mV+1.5/-1.5mV主板RX測試眼寬:45ps+0/-2ps眼寬:18.75ps+0.5/-0.5ps眼高:50mV+0/-5mV眼高:15mV+1.5/-1.5mV 校準(zhǔn)時(shí),信號的參數(shù)分析和調(diào)整需要反復(fù)進(jìn)行,人工操作非常耗時(shí)耗力。為了解決這個(gè) 問題,接收端容限測試時(shí)也會(huì)使用自動(dòng)測試軟件,這個(gè)軟件可以提供設(shè)置和連接向?qū)?、控?誤碼儀和示波器完成自動(dòng)校準(zhǔn)、發(fā)出訓(xùn)練碼型把被測件設(shè)置成環(huán)回狀態(tài),并自動(dòng)進(jìn)行環(huán)回?cái)?shù) 據(jù)的誤碼率統(tǒng)計(jì)。圖4 . 18是典型自動(dòng)校準(zhǔn)和接收容限測試軟件的界面,以及相應(yīng)的測試海南機(jī)械PCI-E測試

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