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安徽PCI-E測(cè)試銷售

來(lái)源: 發(fā)布時(shí)間:2023-03-17

是用矢量網(wǎng)絡(luò)分析儀進(jìn)行鏈路標(biāo)定的典型連接,具體的標(biāo)定步驟非常多,在PCIe4.0 Phy Test Specification文檔里有詳細(xì)描述,這里不做展開(kāi)。

在硬件連接完成、測(cè)試碼型切換正確后,就可以對(duì)信號(hào)進(jìn)行捕獲和信號(hào)質(zhì)量分析。正式 的信號(hào)質(zhì)量分析之前還需要注意的是:為了把傳輸通道對(duì)信號(hào)的惡化以及均衡器對(duì)信號(hào)的 改善效果都考慮進(jìn)去,PCIe3.0及之后標(biāo)準(zhǔn)的測(cè)試中對(duì)其發(fā)送端眼圖、抖動(dòng)等測(cè)試的參考點(diǎn) 從發(fā)送端轉(zhuǎn)移到了接收端。也就是說(shuō),測(cè)試中需要把傳輸通道對(duì)信號(hào)的惡化的影響以及均 衡器對(duì)信號(hào)的改善影響都考慮進(jìn)去。 PCIE3.0和PCIE4.0應(yīng)該如何選擇?安徽PCI-E測(cè)試銷售

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其中,電氣(Electrical) 、協(xié)議(Protocol) 、配置(Configuration)等行為定義了芯片的基本 行為,這些要求合在一起稱為Base規(guī)范,用于指導(dǎo)芯片設(shè)計(jì);基于Base規(guī)范,PCI-SIG還會(huì) 再定義對(duì)于板卡設(shè)計(jì)的要求,比如板卡的機(jī)械尺寸、電氣性能要求,這些要求合在一起稱為 CEM(Card Electromechanical)規(guī)范,用以指導(dǎo)服務(wù)器、計(jì)算機(jī)和插卡等系統(tǒng)設(shè)計(jì)人員的開(kāi) 發(fā)。除了針對(duì)金手指連接類型的板卡,針對(duì)一些新型的連接方式,如M.2、U.2等,也有一 些類似的CEM規(guī)范發(fā)布。DDR測(cè)試PCI-E測(cè)試安裝PCI-E3.0定義了11種發(fā)送端的預(yù)加重設(shè)置,實(shí)際應(yīng)用中應(yīng)該用那個(gè)?

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首先來(lái)看一下惡劣信號(hào)的定義,不是隨便一個(gè)信號(hào)就可以,且惡劣程度要有精確定義才 能保證測(cè)量的重復(fù)性。通常把用于接收端容限測(cè)試的這個(gè)惡劣信號(hào)叫作Stress Eye,即壓 力眼圖,實(shí)際上是借鑒了光通信的叫法。這個(gè)信號(hào)是用高性能的誤碼儀先產(chǎn)生一個(gè)純凈的 帶特定預(yù)加重的信號(hào),然后在這個(gè)信號(hào)上疊加精確控制的隨機(jī)抖動(dòng)(RJ)、周期抖動(dòng)(SJ)、差 模和共模噪聲以及碼間干擾(ISI)。為了確定每個(gè)成分的大小都符合規(guī)范的要求,測(cè)試之前需要先用示波器對(duì)誤碼儀輸出的信號(hào)進(jìn)行校準(zhǔn)。其中,ISI抖動(dòng)是由PCIe協(xié)會(huì)提供的測(cè)試 夾具產(chǎn)生,其夾具上會(huì)模擬典型的主板或者插卡的PCB走線對(duì)信號(hào)的影響。在PCIe3.0的 CBB夾具上,增加了專門的Riser板以模擬服務(wù)器等應(yīng)用場(chǎng)合的走線對(duì)信號(hào)的影響;而在 PCIe4.0和PCIe5.0的夾具上,更是增加了專門的可變ISI的測(cè)試板用于模擬和調(diào)整ISI的 影響。

在2010年推出PCle3.0標(biāo)準(zhǔn)時(shí),為了避免10Gbps的電信號(hào)傳輸帶來(lái)的挑戰(zhàn),PCI-SIG  終把PCle3.0的數(shù)據(jù)傳輸速率定在8Gbps,并在PCle3.0及之后的標(biāo)準(zhǔn)中把8b/10b編碼  更換為更有效的128b/130b編碼,以提高有效的數(shù)據(jù)傳輸帶寬。同時(shí),為了保證數(shù)據(jù)傳輸  密度和直流平衡,還采用了擾碼的方法,即數(shù)據(jù)傳輸前先和一個(gè)多項(xiàng)式進(jìn)行異或,這樣傳輸  鏈路上的數(shù)據(jù)就看起來(lái)比較有隨機(jī)性,可以保證數(shù)據(jù)的直流平衡并方便接收端的時(shí)鐘恢復(fù)。 擾碼后的數(shù)據(jù)到了接收端會(huì)再用相同的多項(xiàng)式把數(shù)據(jù)恢復(fù)出來(lái)。PCI-E3.0的接收端測(cè)試中的Repeater起作用?

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測(cè)試類型8Gbps速率16Gbps速率插卡RX測(cè)試眼寬:41.25ps+0/—2ps眼寬:18.75ps+0.5/-0.5ps眼高:46mV+0/-5mV眼高:15mV+1.5/-1.5mV主板RX測(cè)試眼寬:45ps+0/-2ps眼寬:18.75ps+0.5/-0.5ps眼高:50mV+0/-5mV眼高:15mV+1.5/-1.5mV 校準(zhǔn)時(shí),信號(hào)的參數(shù)分析和調(diào)整需要反復(fù)進(jìn)行,人工操作非常耗時(shí)耗力。為了解決這個(gè) 問(wèn)題,接收端容限測(cè)試時(shí)也會(huì)使用自動(dòng)測(cè)試軟件,這個(gè)軟件可以提供設(shè)置和連接向?qū)?、控?誤碼儀和示波器完成自動(dòng)校準(zhǔn)、發(fā)出訓(xùn)練碼型把被測(cè)件設(shè)置成環(huán)回狀態(tài),并自動(dòng)進(jìn)行環(huán)回?cái)?shù) 據(jù)的誤碼率統(tǒng)計(jì)。圖4 . 18是典型自動(dòng)校準(zhǔn)和接收容限測(cè)試軟件的界面,以及相應(yīng)的測(cè)試PCIe如何解決PCI體系結(jié)構(gòu)存在的問(wèn)題的呢?安徽PCI-E測(cè)試銷售

PCIE與負(fù)載只有時(shí)鐘線和數(shù)據(jù)線,搜索的時(shí)候沒(méi)有控制管理線,怎么找到的寄存器呢?安徽PCI-E測(cè)試銷售

Cle4.0測(cè)試的CBB4和CLB4夾具無(wú)論是Preset還是信號(hào)質(zhì)量的測(cè)試,都需要被測(cè)件工作在特定速率的某些Preset下,要通過(guò)測(cè)試夾具控制被測(cè)件切換到需要的設(shè)置狀態(tài)。具體方法是:在被測(cè)件插入測(cè)試夾具并且上電以后,可以通過(guò)測(cè)試夾具上的切換開(kāi)關(guān)控制DUT輸出不同速率的一致性測(cè)試碼型。在切換測(cè)試夾具上的Toggle開(kāi)關(guān)時(shí),正常的PCle4.0的被測(cè)件依次會(huì)輸出2.5Gbps、5Gbps-3dB、5Gbps-6dB、8GbpsP0、8GbpsP1、8GbpsP2、8GbpsP3、8GbpsP4、8Gbps安徽PCI-E測(cè)試銷售

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